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/third_party/mindspore/mindspore/ops/_op_impl/akg/ascend/
Dinplace_assign.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
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27 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default, DT.F32_Default) \
28 .dtype_format(DT.I32_Default, DT.I32_Default, DT.I32_Default, DT.I32_Default) \
29 .dtype_format(DT.F16_5HD, DT.F16_5HD, DT.F16_5HD, DT.F16_5HD) \
30 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
31 .dtype_format(DT.I32_5HD, DT.I32_5HD, DT.I32_5HD, DT.I32_5HD) \
32 .dtype_format(DT.F16_FracZ, DT.F16_FracZ, DT.F16_FracZ, DT.F16_FracZ) \
33 .dtype_format(DT.F32_FracZ, DT.F32_FracZ, DT.F32_FracZ, DT.F32_FracZ) \
34 .dtype_format(DT.I32_FracZ, DT.I32_FracZ, DT.I32_FracZ, DT.I32_FracZ) \
Dsub.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
25 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default) \
26 .dtype_format(DT.I32_Default, DT.I32_Default, DT.I32_Default) \
27 .dtype_format(DT.F16_5HD, DT.F16_5HD, DT.F16_5HD) \
28 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
29 .dtype_format(DT.I32_5HD, DT.I32_5HD, DT.I32_5HD) \
30 .dtype_format(DT.F16_FracZ, DT.F16_FracZ, DT.F16_FracZ) \
31 .dtype_format(DT.F32_FracZ, DT.F32_FracZ, DT.F32_FracZ) \
32 .dtype_format(DT.I32_FracZ, DT.I32_FracZ, DT.I32_FracZ) \
[all …]
Dadd.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
25 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default) \
26 .dtype_format(DT.I32_Default, DT.I32_Default, DT.I32_Default) \
27 .dtype_format(DT.F16_5HD, DT.F16_5HD, DT.F16_5HD) \
28 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
29 .dtype_format(DT.I32_5HD, DT.I32_5HD, DT.I32_5HD) \
30 .dtype_format(DT.F16_FracZ, DT.F16_FracZ, DT.F16_FracZ) \
31 .dtype_format(DT.F32_FracZ, DT.F32_FracZ, DT.F32_FracZ) \
32 .dtype_format(DT.I32_FracZ, DT.I32_FracZ, DT.I32_FracZ) \
[all …]
Dcast.py16 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
23 .dtype_format(DT.F16_Default, DT.F32_Default) \
24 .dtype_format(DT.F16_Default, DT.I32_Default) \
25 .dtype_format(DT.F32_Default, DT.F16_Default) \
26 .dtype_format(DT.F32_Default, DT.I32_Default) \
27 .dtype_format(DT.I32_Default, DT.F16_Default) \
28 .dtype_format(DT.I32_Default, DT.F32_Default) \
29 .dtype_format(DT.BOOL_Default, DT.F16_Default) \
30 .dtype_format(DT.BOOL_Default, DT.F32_Default) \
31 .dtype_format(DT.BOOL_Default, DT.I32_Default) \
[all …]
Dminimum.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
25 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default) \
26 .dtype_format(DT.I32_Default, DT.I32_Default, DT.I32_Default) \
27 .dtype_format(DT.F16_5HD, DT.F16_5HD, DT.F16_5HD) \
28 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
29 .dtype_format(DT.I32_5HD, DT.I32_5HD, DT.I32_5HD) \
30 .dtype_format(DT.F16_FracNZ, DT.F16_FracNZ, DT.F16_FracNZ) \
31 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ, DT.F32_FracNZ) \
32 .dtype_format(DT.I32_FracNZ, DT.I32_FracNZ, DT.I32_FracNZ) \
Dselect.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
25 .dtype_format(DT.BOOL_Default, DT.F16_Default, DT.F16_Default, DT.F16_Default) \
26 .dtype_format(DT.BOOL_Default, DT.F32_Default, DT.F32_Default, DT.F32_Default) \
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Dmul.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
27 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
28 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default) \
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30 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
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33 .dtype_format(DT.F16_FracNZ, DT.F16_FracNZ, DT.F16_FracNZ) \
34 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ, DT.F32_FracNZ) \
Dmaximum.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
25 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default) \
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29 .dtype_format(DT.I32_5HD, DT.I32_5HD, DT.I32_5HD) \
Dequal.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.BOOL_Default) \
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24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.BOOL_Default) \
25 .dtype_format(DT.F32_Default, DT.F32_Default, DT.BOOL_Default) \
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Dpow.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
25 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default) \
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28 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
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24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default) \
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27 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
28 .dtype_format(DT.F16_FracNZ, DT.F16_FracNZ, DT.F16_FracNZ) \
29 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ, DT.F32_FracNZ) \
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24 .dtype_format(DT.F16_Default, DT.F16_Default, DT.BOOL_Default) \
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23 .dtype_format(DT.F16_Default, DT.F16_Default) \
24 .dtype_format(DT.F32_Default, DT.F32_Default) \
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30 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ) \
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23 .dtype_format(DT.F16_Default, DT.F16_Default) \
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30 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ) \
Dgreater.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
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Dexp.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
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Dsqrt.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
23 .dtype_format(DT.F16_Default, DT.F16_Default) \
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Dabs.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
23 .dtype_format(DT.F16_Default, DT.F16_Default) \
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28 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ) \
Dlog.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
23 .dtype_format(DT.F16_Default, DT.F16_Default) \
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Drsqrt.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
23 .dtype_format(DT.F16_Default, DT.F16_Default) \
24 .dtype_format(DT.F32_Default, DT.F32_Default) \
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Dreduce_sum.py17 from mindspore.ops.op_info_register import op_info_register, AkgAscendRegOp, DataType as DT unknown
26 .dtype_format(DT.F16_Default, DT.F16_Default) \
27 .dtype_format(DT.F32_Default, DT.F32_Default) \
28 .dtype_format(DT.F16_5HD, DT.F16_5HD) \
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31 .dtype_format(DT.F32_FracNZ, DT.F32_FracNZ) \
/third_party/mindspore/mindspore/ops/_op_impl/akg/gpu/
Dinplace_assign.py17 from mindspore.ops.op_info_register import op_info_register, AkgGpuRegOp, DataType as DT unknown
26 .dtype_format(DT.F16_Default, DT.F16_Default, DT.F16_Default, DT.F16_Default) \
27 .dtype_format(DT.F32_Default, DT.F32_Default, DT.F32_Default, DT.F32_Default) \
28 .dtype_format(DT.I32_Default, DT.I32_Default, DT.I32_Default, DT.I32_Default) \
29 .dtype_format(DT.F16_5HD, DT.F16_5HD, DT.F16_5HD, DT.F16_5HD) \
30 .dtype_format(DT.F32_5HD, DT.F32_5HD, DT.F32_5HD, DT.F32_5HD) \
31 .dtype_format(DT.I32_5HD, DT.I32_5HD, DT.I32_5HD, DT.I32_5HD) \
32 .dtype_format(DT.F16_FracZ, DT.F16_FracZ, DT.F16_FracZ, DT.F16_FracZ) \
33 .dtype_format(DT.F32_FracZ, DT.F32_FracZ, DT.F32_FracZ, DT.F32_FracZ) \
34 .dtype_format(DT.I32_FracZ, DT.I32_FracZ, DT.I32_FracZ, DT.I32_FracZ) \
/third_party/skia/third_party/externals/swiftshader/third_party/llvm-10.0/llvm/include/llvm/Support/
DGenericDomTreeConstruction.h176 TreeNodePtr getNodeForBlock(NodePtr BB, DomTreeT &DT) { in getNodeForBlock()
177 if (TreeNodePtr Node = DT.getNode(BB)) return Node; in getNodeForBlock()
183 assert(IDom || DT.DomTreeNodes[nullptr]); in getNodeForBlock()
184 TreeNodePtr IDomNode = getNodeForBlock(IDom, DT); in getNodeForBlock()
188 return (DT.DomTreeNodes[BB] = IDomNode->addChild( in getNodeForBlock()
304 void runSemiNCA(DomTreeT &DT, const unsigned MinLevel = 0) {
325 const TreeNodePtr TN = DT.getNode(N);
375 static NodePtr GetEntryNode(const DomTreeT &DT) { in GetEntryNode()
376 assert(DT.Parent && "Parent not set"); in GetEntryNode()
377 return GraphTraits<typename DomTreeT::ParentPtr>::getEntryNode(DT.Parent); in GetEntryNode()
[all …]

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