Lines Matching refs:clkr
29 struct clk_regmap_div, clkr)
185 .clkr.hw.init = &(struct clk_init_data){
196 .clkr = {
213 .clkr = {
238 .clkr.hw.init = &(struct clk_init_data){
248 .clkr = {
268 .clkr.hw.init = &(struct clk_init_data){
278 .clkr = {
310 .clkr.hw.init = &(struct clk_init_data){
320 .clkr = {
341 .clkr.hw.init = &(struct clk_init_data){
351 .clkr = {
386 .clkr.hw.init = &(struct clk_init_data){
396 .clkr = {
417 .clkr.hw.init = &(struct clk_init_data){
427 .clkr = {
455 .clkr.hw.init = &(struct clk_init_data){
465 .clkr = {
486 .clkr.hw.init = &(struct clk_init_data){
496 .clkr = {
517 .clkr.hw.init = &(struct clk_init_data){
527 .clkr = {
558 .clkr.hw.init = &(struct clk_init_data){
590 .clkr.hw.init = &(struct clk_init_data){
610 .clkr.hw.init = &(struct clk_init_data){
621 .clkr = {
639 .clkr = {
655 .clkr = {
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706 .clkr = {
723 .clkr = {
739 .clkr = {
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805 .clkr = {
821 .clkr = {
838 .clkr = {
854 .clkr = {
870 .clkr = {
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902 .clkr = {
920 .clkr = {
936 .clkr = {
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968 .clkr = {
993 .clkr.hw.init = &(struct clk_init_data){
1003 .clkr = {
1019 .clkr = {
1035 .clkr = {
1060 .clkr.hw.init = &(struct clk_init_data){
1080 .clkr.hw.init = &(struct clk_init_data){
1091 .clkr = {
1108 .clkr = {
1125 .clkr = {
1150 .clkr.hw.init = &(struct clk_init_data){
1160 .clkr = {
1177 .clkr = {
1194 .clkr = {
1217 regmap_read(pll_div->cdiv.clkr.regmap, pll_vco->reg, &cdiv); in clk_fepll_vco_calc_rate()
1286 ret = regmap_update_bits(pll->cdiv.clkr.regmap, in clk_cpu_div_set_rate()
1312 regmap_read(pll->cdiv.clkr.regmap, pll->cdiv.reg, &cdiv); in clk_cpu_div_recalc_rate()
1359 .cdiv.clkr = {
1392 regmap_read(pll->cdiv.clkr.regmap, pll->cdiv.reg, &cdiv); in clk_regmap_clk_div_recalc_rate()
1413 .cdiv.clkr = {
1428 .cdiv.clkr = {
1443 .cdiv.clkr = {
1458 .cdiv.clkr = {
1473 .cdiv.clkr = {
1498 .cdiv.clkr = {
1516 .cdiv.clkr = {
1541 .clkr.hw.init = &(struct clk_init_data){
1551 .clkr = {
1568 [AUDIO_CLK_SRC] = &audio_clk_src.clkr,
1569 [BLSP1_QUP1_I2C_APPS_CLK_SRC] = &blsp1_qup1_i2c_apps_clk_src.clkr,
1570 [BLSP1_QUP1_SPI_APPS_CLK_SRC] = &blsp1_qup1_spi_apps_clk_src.clkr,
1571 [BLSP1_QUP2_I2C_APPS_CLK_SRC] = &blsp1_qup2_i2c_apps_clk_src.clkr,
1572 [BLSP1_QUP2_SPI_APPS_CLK_SRC] = &blsp1_qup2_spi_apps_clk_src.clkr,
1573 [BLSP1_UART1_APPS_CLK_SRC] = &blsp1_uart1_apps_clk_src.clkr,
1574 [BLSP1_UART2_APPS_CLK_SRC] = &blsp1_uart2_apps_clk_src.clkr,
1575 [GCC_USB3_MOCK_UTMI_CLK_SRC] = &usb30_mock_utmi_clk_src.clkr,
1576 [GCC_APPS_CLK_SRC] = &apps_clk_src.clkr,
1577 [GCC_APPS_AHB_CLK_SRC] = &apps_ahb_clk_src.clkr,
1578 [GP1_CLK_SRC] = &gp1_clk_src.clkr,
1579 [GP2_CLK_SRC] = &gp2_clk_src.clkr,
1580 [GP3_CLK_SRC] = &gp3_clk_src.clkr,
1581 [SDCC1_APPS_CLK_SRC] = &sdcc1_apps_clk_src.clkr,
1582 [FEPHY_125M_DLY_CLK_SRC] = &fephy_125m_dly_clk_src.clkr,
1583 [WCSS2G_CLK_SRC] = &wcss2g_clk_src.clkr,
1584 [WCSS5G_CLK_SRC] = &wcss5g_clk_src.clkr,
1585 [GCC_APSS_AHB_CLK] = &gcc_apss_ahb_clk.clkr,
1586 [GCC_AUDIO_AHB_CLK] = &gcc_audio_ahb_clk.clkr,
1587 [GCC_AUDIO_PWM_CLK] = &gcc_audio_pwm_clk.clkr,
1588 [GCC_BLSP1_AHB_CLK] = &gcc_blsp1_ahb_clk.clkr,
1589 [GCC_BLSP1_QUP1_I2C_APPS_CLK] = &gcc_blsp1_qup1_i2c_apps_clk.clkr,
1590 [GCC_BLSP1_QUP1_SPI_APPS_CLK] = &gcc_blsp1_qup1_spi_apps_clk.clkr,
1591 [GCC_BLSP1_QUP2_I2C_APPS_CLK] = &gcc_blsp1_qup2_i2c_apps_clk.clkr,
1592 [GCC_BLSP1_QUP2_SPI_APPS_CLK] = &gcc_blsp1_qup2_spi_apps_clk.clkr,
1593 [GCC_BLSP1_UART1_APPS_CLK] = &gcc_blsp1_uart1_apps_clk.clkr,
1594 [GCC_BLSP1_UART2_APPS_CLK] = &gcc_blsp1_uart2_apps_clk.clkr,
1595 [GCC_DCD_XO_CLK] = &gcc_dcd_xo_clk.clkr,
1596 [GCC_GP1_CLK] = &gcc_gp1_clk.clkr,
1597 [GCC_GP2_CLK] = &gcc_gp2_clk.clkr,
1598 [GCC_GP3_CLK] = &gcc_gp3_clk.clkr,
1599 [GCC_BOOT_ROM_AHB_CLK] = &gcc_boot_rom_ahb_clk.clkr,
1600 [GCC_CRYPTO_AHB_CLK] = &gcc_crypto_ahb_clk.clkr,
1601 [GCC_CRYPTO_AXI_CLK] = &gcc_crypto_axi_clk.clkr,
1602 [GCC_CRYPTO_CLK] = &gcc_crypto_clk.clkr,
1603 [GCC_ESS_CLK] = &gcc_ess_clk.clkr,
1604 [GCC_IMEM_AXI_CLK] = &gcc_imem_axi_clk.clkr,
1605 [GCC_IMEM_CFG_AHB_CLK] = &gcc_imem_cfg_ahb_clk.clkr,
1606 [GCC_PCIE_AHB_CLK] = &gcc_pcie_ahb_clk.clkr,
1607 [GCC_PCIE_AXI_M_CLK] = &gcc_pcie_axi_m_clk.clkr,
1608 [GCC_PCIE_AXI_S_CLK] = &gcc_pcie_axi_s_clk.clkr,
1609 [GCC_PRNG_AHB_CLK] = &gcc_prng_ahb_clk.clkr,
1610 [GCC_QPIC_AHB_CLK] = &gcc_qpic_ahb_clk.clkr,
1611 [GCC_QPIC_CLK] = &gcc_qpic_clk.clkr,
1612 [GCC_SDCC1_AHB_CLK] = &gcc_sdcc1_ahb_clk.clkr,
1613 [GCC_SDCC1_APPS_CLK] = &gcc_sdcc1_apps_clk.clkr,
1614 [GCC_TLMM_AHB_CLK] = &gcc_tlmm_ahb_clk.clkr,
1615 [GCC_USB2_MASTER_CLK] = &gcc_usb2_master_clk.clkr,
1616 [GCC_USB2_SLEEP_CLK] = &gcc_usb2_sleep_clk.clkr,
1617 [GCC_USB2_MOCK_UTMI_CLK] = &gcc_usb2_mock_utmi_clk.clkr,
1618 [GCC_USB3_MASTER_CLK] = &gcc_usb3_master_clk.clkr,
1619 [GCC_USB3_SLEEP_CLK] = &gcc_usb3_sleep_clk.clkr,
1620 [GCC_USB3_MOCK_UTMI_CLK] = &gcc_usb3_mock_utmi_clk.clkr,
1621 [GCC_WCSS2G_CLK] = &gcc_wcss2g_clk.clkr,
1622 [GCC_WCSS2G_REF_CLK] = &gcc_wcss2g_ref_clk.clkr,
1623 [GCC_WCSS2G_RTC_CLK] = &gcc_wcss2g_rtc_clk.clkr,
1624 [GCC_WCSS5G_CLK] = &gcc_wcss5g_clk.clkr,
1625 [GCC_WCSS5G_REF_CLK] = &gcc_wcss5g_ref_clk.clkr,
1626 [GCC_WCSS5G_RTC_CLK] = &gcc_wcss5g_rtc_clk.clkr,
1627 [GCC_SDCC_PLLDIV_CLK] = &gcc_apss_sdcc_clk.cdiv.clkr,
1628 [GCC_FEPLL125_CLK] = &gcc_fepll125_clk.cdiv.clkr,
1629 [GCC_FEPLL125DLY_CLK] = &gcc_fepll125dly_clk.cdiv.clkr,
1630 [GCC_FEPLL200_CLK] = &gcc_fepll200_clk.cdiv.clkr,
1631 [GCC_FEPLL500_CLK] = &gcc_fepll500_clk.cdiv.clkr,
1632 [GCC_FEPLL_WCSS2G_CLK] = &gcc_fepllwcss2g_clk.cdiv.clkr,
1633 [GCC_FEPLL_WCSS5G_CLK] = &gcc_fepllwcss5g_clk.cdiv.clkr,
1634 [GCC_APSS_CPU_PLLDIV_CLK] = &gcc_apss_cpu_plldiv_clk.cdiv.clkr,
1635 [GCC_PCNOC_AHB_CLK_SRC] = &gcc_pcnoc_ahb_clk_src.clkr,
1636 [GCC_PCNOC_AHB_CLK] = &pcnoc_clk_src.clkr,
1742 err = clk_rcg2_ops.set_parent(&apps_clk_src.clkr.hw, in gcc_ipq4019_cpu_clk_notifier_fn()
1760 return clk_notifier_register(apps_clk_src.clkr.hw.clk, in gcc_ipq4019_probe()
1766 return clk_notifier_unregister(apps_clk_src.clkr.hw.clk, in gcc_ipq4019_remove()