; NOTE: Assertions have been autogenerated by utils/update_llc_test_checks.py ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=sse2 | FileCheck %s --check-prefixes=SSE,SSE2 ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=sse4.2 | FileCheck %s --check-prefixes=SSE,SSE4 ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=avx | FileCheck %s --check-prefixes=AVX,AVX1OR2,AVX1 ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=avx2 | FileCheck %s --check-prefixes=AVX,AVX1OR2,AVX2 ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=avx512f | FileCheck %s --check-prefixes=AVX,AVX512,AVX512F ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=avx512f,avx512dq,avx512vl | FileCheck %s --check-prefixes=AVX,AVX512,AVX512VL,AVX512VLDQ ; RUN: llc < %s -mtriple=x86_64-apple-darwin -mattr=avx512f,avx512bw,avx512vl | FileCheck %s --check-prefixes=AVX,AVX512,AVX512VL,AVX512VLBW ; RUN: llc < %s -mtriple=i686-apple-darwin -mattr=avx512f,avx512bw,avx512dq,avx512vl | FileCheck %s --check-prefixes=X86-AVX512 ; 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X86-AVX512-NEXT: retl %mask = icmp slt <4 x i64> %trigger, zeroinitializer call void @llvm.masked.store.v4f64.p0v4f64(<4 x double> %val, <4 x double>* %addr, i32 4, <4 x i1> %mask) ret void } ; ; vXf32 ; define void @store_v2f32_v2i32(<2 x i32> %trigger, <2 x float>* %addr, <2 x float> %val) { ; SSE2-LABEL: store_v2f32_v2i32: ; SSE2: ## %bb.0: ; SSE2-NEXT: pxor %xmm2, %xmm2 ; SSE2-NEXT: pcmpeqd %xmm0, %xmm2 ; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm2[0,0,1,1] ; SSE2-NEXT: movmskpd %xmm0, %eax ; SSE2-NEXT: testb $1, %al ; SSE2-NEXT: jne LBB3_1 ; SSE2-NEXT: ## %bb.2: ## %else ; SSE2-NEXT: testb $2, %al ; SSE2-NEXT: jne LBB3_3 ; SSE2-NEXT: LBB3_4: ## %else2 ; SSE2-NEXT: retq ; SSE2-NEXT: LBB3_1: ## %cond.store ; SSE2-NEXT: movss %xmm1, (%rdi) ; SSE2-NEXT: testb $2, %al ; SSE2-NEXT: je LBB3_4 ; SSE2-NEXT: LBB3_3: ## %cond.store1 ; SSE2-NEXT: shufps {{.*#+}} xmm1 = xmm1[1,1,1,1] ; SSE2-NEXT: movss %xmm1, 4(%rdi) ; SSE2-NEXT: retq ; ; SSE4-LABEL: store_v2f32_v2i32: ; SSE4: ## %bb.0: ; SSE4-NEXT: pxor %xmm2, %xmm2 ; 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X86-AVX512-NEXT: vptestnmb %ymm0, %ymm0, %k1 ; X86-AVX512-NEXT: vmovdqu8 %ymm1, (%eax) {%k1} ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl %mask = icmp eq <32 x i8> %trigger, zeroinitializer call void @llvm.masked.store.v32i8.p0v32i8(<32 x i8> %val, <32 x i8>* %addr, i32 4, <32 x i1> %mask) ret void } ;;; Stores with Constant Masks define void @mstore_constmask_v4i32_v4i32(<4 x i32> %trigger, <4 x i32>* %addr, <4 x i32> %val) { ; SSE-LABEL: mstore_constmask_v4i32_v4i32: ; SSE: ## %bb.0: ; SSE-NEXT: movups %xmm1, (%rdi) ; SSE-NEXT: retq ; ; AVX-LABEL: mstore_constmask_v4i32_v4i32: ; AVX: ## %bb.0: ; AVX-NEXT: vmovups %xmm1, (%rdi) ; AVX-NEXT: retq ; ; X86-AVX512-LABEL: mstore_constmask_v4i32_v4i32: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vmovups %xmm1, (%eax) ; X86-AVX512-NEXT: retl %mask = icmp eq <4 x i32> %trigger, zeroinitializer call void @llvm.masked.store.v4i32.p0v4i32(<4 x i32> %val, <4 x i32>* %addr, i32 4, <4 x i1>) ret void } ; Make sure we are able to detect all ones constant mask after type legalization ; to avoid masked stores. define void @mstore_constmask_allones_split(<16 x i64> %trigger, <16 x i64>* %addr, <16 x i64> %val) { ; SSE2-LABEL: mstore_constmask_allones_split: ; SSE2: ## %bb.0: ; SSE2-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm0 ; SSE2-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm1 ; SSE2-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm2 ; SSE2-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm3 ; SSE2-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm4 ; SSE2-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm5 ; SSE2-NEXT: movq %xmm5, (%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm5 = xmm5[2,3,2,3] ; SSE2-NEXT: movq %xmm5, 8(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm5 = mem[2,3,2,3] ; SSE2-NEXT: movq %xmm5, 24(%rdi) ; SSE2-NEXT: movq {{[0-9]+}}(%rsp), %rax ; SSE2-NEXT: movq %rax, 32(%rdi) ; SSE2-NEXT: movq %xmm4, 48(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm4 = xmm4[2,3,2,3] ; SSE2-NEXT: movq %xmm4, 56(%rdi) ; SSE2-NEXT: movq %xmm3, 64(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm3 = xmm3[2,3,2,3] ; SSE2-NEXT: movq %xmm3, 72(%rdi) ; SSE2-NEXT: movq %xmm2, 80(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm2 = xmm2[2,3,2,3] ; SSE2-NEXT: movq %xmm2, 88(%rdi) ; SSE2-NEXT: movq %xmm1, 96(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm1 = xmm1[2,3,2,3] ; SSE2-NEXT: movq %xmm1, 104(%rdi) ; SSE2-NEXT: movq %xmm0, 112(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm0[2,3,2,3] ; SSE2-NEXT: movq %xmm0, 120(%rdi) ; SSE2-NEXT: retq ; ; SSE4-LABEL: mstore_constmask_allones_split: ; SSE4: ## %bb.0: ; SSE4-NEXT: movaps {{[0-9]+}}(%rsp), %xmm0 ; SSE4-NEXT: movaps {{[0-9]+}}(%rsp), %xmm1 ; SSE4-NEXT: movaps {{[0-9]+}}(%rsp), %xmm2 ; SSE4-NEXT: movaps {{[0-9]+}}(%rsp), %xmm3 ; SSE4-NEXT: movaps {{[0-9]+}}(%rsp), %xmm4 ; SSE4-NEXT: movdqa {{[0-9]+}}(%rsp), %xmm5 ; SSE4-NEXT: movaps {{[0-9]+}}(%rsp), %xmm6 ; SSE4-NEXT: movups %xmm6, (%rdi) ; SSE4-NEXT: palignr {{.*#+}} xmm5 = mem[8,9,10,11,12,13,14,15],xmm5[0,1,2,3,4,5,6,7] ; SSE4-NEXT: movdqu %xmm5, 24(%rdi) ; SSE4-NEXT: movups %xmm4, 48(%rdi) ; SSE4-NEXT: movups %xmm3, 64(%rdi) ; SSE4-NEXT: movups %xmm2, 80(%rdi) ; SSE4-NEXT: movups %xmm1, 96(%rdi) ; SSE4-NEXT: movups %xmm0, 112(%rdi) ; SSE4-NEXT: retq ; ; AVX1-LABEL: mstore_constmask_allones_split: ; AVX1: ## %bb.0: ; AVX1-NEXT: vmovapd {{.*#+}} ymm0 = [18446744073709551615,0,18446744073709551615,18446744073709551615] ; AVX1-NEXT: vmaskmovpd %ymm5, %ymm0, 32(%rdi) ; AVX1-NEXT: vmovapd {{.*#+}} ymm0 = [18446744073709551615,18446744073709551615,0,18446744073709551615] ; AVX1-NEXT: vmaskmovpd %ymm4, %ymm0, (%rdi) ; AVX1-NEXT: vmovups %ymm7, 96(%rdi) ; AVX1-NEXT: vmovups %ymm6, 64(%rdi) ; AVX1-NEXT: vzeroupper ; AVX1-NEXT: retq ; ; AVX2-LABEL: mstore_constmask_allones_split: ; AVX2: ## %bb.0: ; AVX2-NEXT: vmovdqa {{.*#+}} ymm0 = [18446744073709551615,0,18446744073709551615,18446744073709551615] ; AVX2-NEXT: vpmaskmovq %ymm5, %ymm0, 32(%rdi) ; AVX2-NEXT: vmovdqa {{.*#+}} ymm0 = [18446744073709551615,18446744073709551615,0,18446744073709551615] ; AVX2-NEXT: vpmaskmovq %ymm4, %ymm0, (%rdi) ; AVX2-NEXT: vmovups %ymm7, 96(%rdi) ; AVX2-NEXT: vmovups %ymm6, 64(%rdi) ; AVX2-NEXT: vzeroupper ; AVX2-NEXT: retq ; ; AVX512F-LABEL: mstore_constmask_allones_split: ; AVX512F: ## %bb.0: ; AVX512F-NEXT: movb $-37, %al ; AVX512F-NEXT: kmovw %eax, %k1 ; AVX512F-NEXT: vmovdqu64 %zmm2, (%rdi) {%k1} ; AVX512F-NEXT: vmovups %zmm3, 64(%rdi) ; AVX512F-NEXT: vzeroupper ; AVX512F-NEXT: retq ; ; AVX512VLDQ-LABEL: mstore_constmask_allones_split: ; AVX512VLDQ: ## %bb.0: ; AVX512VLDQ-NEXT: movb $-37, %al ; AVX512VLDQ-NEXT: kmovw %eax, %k1 ; AVX512VLDQ-NEXT: vmovdqu64 %zmm2, (%rdi) {%k1} ; AVX512VLDQ-NEXT: vmovups %zmm3, 64(%rdi) ; AVX512VLDQ-NEXT: vzeroupper ; AVX512VLDQ-NEXT: retq ; ; AVX512VLBW-LABEL: mstore_constmask_allones_split: ; AVX512VLBW: ## %bb.0: ; AVX512VLBW-NEXT: movb $-37, %al ; AVX512VLBW-NEXT: kmovd %eax, %k1 ; AVX512VLBW-NEXT: vmovdqu64 %zmm2, (%rdi) {%k1} ; AVX512VLBW-NEXT: vmovups %zmm3, 64(%rdi) ; AVX512VLBW-NEXT: vzeroupper ; AVX512VLBW-NEXT: retq ; ; X86-AVX512-LABEL: mstore_constmask_allones_split: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: movb $-37, %cl ; X86-AVX512-NEXT: kmovd %ecx, %k1 ; X86-AVX512-NEXT: vmovdqu64 %zmm2, (%eax) {%k1} ; X86-AVX512-NEXT: vmovups %zmm3, 64(%eax) ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl %mask = icmp eq <16 x i64> %trigger, zeroinitializer call void @llvm.masked.store.v16i64.p0v16i64(<16 x i64> %val, <16 x i64>* %addr, i32 4, <16 x i1>) ret void } ; When only one element of the mask is set, reduce to a scalar store. define void @one_mask_bit_set1(<4 x i32>* %addr, <4 x i32> %val) { ; SSE-LABEL: one_mask_bit_set1: ; SSE: ## %bb.0: ; SSE-NEXT: movss %xmm0, (%rdi) ; SSE-NEXT: retq ; ; AVX-LABEL: one_mask_bit_set1: ; AVX: ## %bb.0: ; AVX-NEXT: vmovss %xmm0, (%rdi) ; AVX-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set1: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vmovss %xmm0, (%eax) ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v4i32.p0v4i32(<4 x i32> %val, <4 x i32>* %addr, i32 4, <4 x i1>) ret void } ; Choose a different element to show that the correct address offset is produced. define void @one_mask_bit_set2(<4 x float>* %addr, <4 x float> %val) { ; SSE2-LABEL: one_mask_bit_set2: ; SSE2: ## %bb.0: ; SSE2-NEXT: movhlps {{.*#+}} xmm0 = xmm0[1,1] ; SSE2-NEXT: movss %xmm0, 8(%rdi) ; SSE2-NEXT: retq ; ; SSE4-LABEL: one_mask_bit_set2: ; SSE4: ## %bb.0: ; SSE4-NEXT: extractps $2, %xmm0, 8(%rdi) ; SSE4-NEXT: retq ; ; AVX-LABEL: one_mask_bit_set2: ; AVX: ## %bb.0: ; AVX-NEXT: vextractps $2, %xmm0, 8(%rdi) ; AVX-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set2: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vextractps $2, %xmm0, 8(%eax) ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v4f32.p0v4f32(<4 x float> %val, <4 x float>* %addr, i32 4, <4 x i1>) ret void } ; Choose a different scalar type and a high element of a 256-bit vector because AVX doesn't support those evenly. define void @one_mask_bit_set3(<4 x i64>* %addr, <4 x i64> %val) { ; SSE-LABEL: one_mask_bit_set3: ; SSE: ## %bb.0: ; SSE-NEXT: movlps %xmm1, 16(%rdi) ; SSE-NEXT: retq ; ; AVX-LABEL: one_mask_bit_set3: ; AVX: ## %bb.0: ; AVX-NEXT: vextractf128 $1, %ymm0, %xmm0 ; AVX-NEXT: vmovlps %xmm0, 16(%rdi) ; AVX-NEXT: vzeroupper ; AVX-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set3: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vextractf128 $1, %ymm0, %xmm0 ; X86-AVX512-NEXT: vmovlps %xmm0, 16(%eax) ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v4i64.p0v4i64(<4 x i64> %val, <4 x i64>* %addr, i32 4, <4 x i1>) ret void } ; Choose a different scalar type and a high element of a 256-bit vector because AVX doesn't support those evenly. define void @one_mask_bit_set4(<4 x double>* %addr, <4 x double> %val) { ; SSE-LABEL: one_mask_bit_set4: ; SSE: ## %bb.0: ; SSE-NEXT: movhps %xmm1, 24(%rdi) ; SSE-NEXT: retq ; ; AVX-LABEL: one_mask_bit_set4: ; AVX: ## %bb.0: ; AVX-NEXT: vextractf128 $1, %ymm0, %xmm0 ; AVX-NEXT: vmovhps %xmm0, 24(%rdi) ; AVX-NEXT: vzeroupper ; AVX-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set4: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vextractf128 $1, %ymm0, %xmm0 ; X86-AVX512-NEXT: vmovhps %xmm0, 24(%eax) ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v4f64.p0v4f64(<4 x double> %val, <4 x double>* %addr, i32 4, <4 x i1>) ret void } ; Try a 512-bit vector to make sure AVX doesn't die and AVX512 works as expected. define void @one_mask_bit_set5(<8 x double>* %addr, <8 x double> %val) { ; SSE-LABEL: one_mask_bit_set5: ; SSE: ## %bb.0: ; SSE-NEXT: movlps %xmm3, 48(%rdi) ; SSE-NEXT: retq ; ; AVX1OR2-LABEL: one_mask_bit_set5: ; AVX1OR2: ## %bb.0: ; AVX1OR2-NEXT: vextractf128 $1, %ymm1, %xmm0 ; AVX1OR2-NEXT: vmovlps %xmm0, 48(%rdi) ; AVX1OR2-NEXT: vzeroupper ; AVX1OR2-NEXT: retq ; ; AVX512-LABEL: one_mask_bit_set5: ; AVX512: ## %bb.0: ; AVX512-NEXT: vextractf32x4 $3, %zmm0, %xmm0 ; AVX512-NEXT: vmovlps %xmm0, 48(%rdi) ; AVX512-NEXT: vzeroupper ; AVX512-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set5: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vextractf32x4 $3, %zmm0, %xmm0 ; X86-AVX512-NEXT: vmovlps %xmm0, 48(%eax) ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v8f64.p0v8f64(<8 x double> %val, <8 x double>* %addr, i32 4, <8 x i1>) ret void } ; Try one elt in each half of a vector that needs to split define void @one_mask_bit_set6(<16 x i64>* %addr, <16 x i64> %val) { ; SSE2-LABEL: one_mask_bit_set6: ; SSE2: ## %bb.0: ; SSE2-NEXT: movlps %xmm3, 48(%rdi) ; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm5[2,3,2,3] ; SSE2-NEXT: movq %xmm0, 88(%rdi) ; SSE2-NEXT: retq ; ; SSE4-LABEL: one_mask_bit_set6: ; SSE4: ## %bb.0: ; SSE4-NEXT: movlps %xmm3, 48(%rdi) ; SSE4-NEXT: pextrq $1, %xmm5, 88(%rdi) ; SSE4-NEXT: retq ; ; AVX1-LABEL: one_mask_bit_set6: ; AVX1: ## %bb.0: ; AVX1-NEXT: vmovapd {{.*#+}} ymm0 = [0,0,0,18446744073709551615] ; AVX1-NEXT: vmaskmovpd %ymm2, %ymm0, 64(%rdi) ; AVX1-NEXT: vmovapd {{.*#+}} ymm0 = [0,0,18446744073709551615,0] ; AVX1-NEXT: vmaskmovpd %ymm1, %ymm0, 32(%rdi) ; AVX1-NEXT: vzeroupper ; AVX1-NEXT: retq ; ; AVX2-LABEL: one_mask_bit_set6: ; AVX2: ## %bb.0: ; AVX2-NEXT: vmovdqa {{.*#+}} ymm0 = [0,0,0,18446744073709551615] ; AVX2-NEXT: vpmaskmovq %ymm2, %ymm0, 64(%rdi) ; AVX2-NEXT: vmovdqa {{.*#+}} ymm0 = [0,0,18446744073709551615,0] ; AVX2-NEXT: vpmaskmovq %ymm1, %ymm0, 32(%rdi) ; AVX2-NEXT: vzeroupper ; AVX2-NEXT: retq ; ; AVX512-LABEL: one_mask_bit_set6: ; AVX512: ## %bb.0: ; AVX512-NEXT: vextractf32x4 $3, %zmm0, %xmm0 ; AVX512-NEXT: vmovlps %xmm0, 48(%rdi) ; AVX512-NEXT: vextracti128 $1, %ymm1, %xmm0 ; AVX512-NEXT: vpextrq $1, %xmm0, 88(%rdi) ; AVX512-NEXT: vzeroupper ; AVX512-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set6: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vextractf32x4 $3, %zmm0, %xmm0 ; X86-AVX512-NEXT: vmovlps %xmm0, 48(%eax) ; X86-AVX512-NEXT: vextractf128 $1, %ymm1, %xmm0 ; X86-AVX512-NEXT: vpermilps {{.*#+}} xmm0 = xmm0[2,3,0,1] ; X86-AVX512-NEXT: vmovlps %xmm0, 88(%eax) ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v16i64.p0v16i64(<16 x i64> %val, <16 x i64>* %addr, i32 4, <16 x i1>) ret void } ; SimplifyDemandedBits eliminates an ashr here. define void @masked_store_bool_mask_demand_trunc_sext(<4 x double> %x, <4 x double>* %p, <4 x i32> %masksrc) { ; SSE-LABEL: masked_store_bool_mask_demand_trunc_sext: ; SSE: ## %bb.0: ; SSE-NEXT: pslld $31, %xmm2 ; SSE-NEXT: movmskps %xmm2, %eax ; SSE-NEXT: testb $1, %al ; SSE-NEXT: jne LBB25_1 ; SSE-NEXT: ## %bb.2: ## %else ; SSE-NEXT: testb $2, %al ; SSE-NEXT: jne LBB25_3 ; SSE-NEXT: LBB25_4: ## %else2 ; SSE-NEXT: testb $4, %al ; SSE-NEXT: jne LBB25_5 ; SSE-NEXT: LBB25_6: ## %else4 ; SSE-NEXT: testb $8, %al ; SSE-NEXT: jne LBB25_7 ; SSE-NEXT: LBB25_8: ## %else6 ; SSE-NEXT: retq ; SSE-NEXT: LBB25_1: ## %cond.store ; SSE-NEXT: movlps %xmm0, (%rdi) ; SSE-NEXT: testb $2, %al ; SSE-NEXT: je LBB25_4 ; SSE-NEXT: LBB25_3: ## %cond.store1 ; SSE-NEXT: movhps %xmm0, 8(%rdi) ; SSE-NEXT: testb $4, %al ; SSE-NEXT: je LBB25_6 ; SSE-NEXT: LBB25_5: ## %cond.store3 ; SSE-NEXT: movlps %xmm1, 16(%rdi) ; SSE-NEXT: testb $8, %al ; SSE-NEXT: je LBB25_8 ; SSE-NEXT: LBB25_7: ## %cond.store5 ; SSE-NEXT: movhps %xmm1, 24(%rdi) ; SSE-NEXT: retq ; ; AVX1-LABEL: masked_store_bool_mask_demand_trunc_sext: ; AVX1: ## %bb.0: ; AVX1-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX1-NEXT: vpmovsxdq %xmm1, %xmm2 ; AVX1-NEXT: vpshufd {{.*#+}} xmm1 = xmm1[2,3,2,3] ; AVX1-NEXT: vpmovsxdq %xmm1, %xmm1 ; AVX1-NEXT: vinsertf128 $1, %xmm1, %ymm2, %ymm1 ; AVX1-NEXT: vmaskmovpd %ymm0, %ymm1, (%rdi) ; AVX1-NEXT: vzeroupper ; AVX1-NEXT: retq ; ; AVX2-LABEL: masked_store_bool_mask_demand_trunc_sext: ; AVX2: ## %bb.0: ; AVX2-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX2-NEXT: vpmovsxdq %xmm1, %ymm1 ; AVX2-NEXT: vmaskmovpd %ymm0, %ymm1, (%rdi) ; AVX2-NEXT: vzeroupper ; AVX2-NEXT: retq ; ; AVX512F-LABEL: masked_store_bool_mask_demand_trunc_sext: ; AVX512F: ## %bb.0: ; AVX512F-NEXT: ## kill: def $ymm0 killed $ymm0 def $zmm0 ; AVX512F-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX512F-NEXT: vptestmd %zmm1, %zmm1, %k0 ; AVX512F-NEXT: kshiftlw $12, %k0, %k0 ; AVX512F-NEXT: kshiftrw $12, %k0, %k1 ; AVX512F-NEXT: vmovupd %zmm0, (%rdi) {%k1} ; AVX512F-NEXT: vzeroupper ; AVX512F-NEXT: retq ; ; AVX512VLDQ-LABEL: masked_store_bool_mask_demand_trunc_sext: ; AVX512VLDQ: ## %bb.0: ; AVX512VLDQ-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX512VLDQ-NEXT: vpmovd2m %xmm1, %k1 ; AVX512VLDQ-NEXT: vmovupd %ymm0, (%rdi) {%k1} ; AVX512VLDQ-NEXT: vzeroupper ; AVX512VLDQ-NEXT: retq ; ; AVX512VLBW-LABEL: masked_store_bool_mask_demand_trunc_sext: ; AVX512VLBW: ## %bb.0: ; AVX512VLBW-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX512VLBW-NEXT: vptestmd %xmm1, %xmm1, %k1 ; AVX512VLBW-NEXT: vmovupd %ymm0, (%rdi) {%k1} ; AVX512VLBW-NEXT: vzeroupper ; AVX512VLBW-NEXT: retq ; ; X86-AVX512-LABEL: masked_store_bool_mask_demand_trunc_sext: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vpslld $31, %xmm1, %xmm1 ; X86-AVX512-NEXT: vpmovd2m %xmm1, %k1 ; X86-AVX512-NEXT: vmovupd %ymm0, (%eax) {%k1} ; X86-AVX512-NEXT: vzeroupper ; X86-AVX512-NEXT: retl %sext = sext <4 x i32> %masksrc to <4 x i64> %boolmask = trunc <4 x i64> %sext to <4 x i1> call void @llvm.masked.store.v4f64.p0v4f64(<4 x double> %x, <4 x double>* %p, i32 4, <4 x i1> %boolmask) ret void } ; PR26697 define void @one_mask_bit_set1_variable(<4 x float>* %addr, <4 x float> %val, <4 x i32> %mask) { ; SSE2-LABEL: one_mask_bit_set1_variable: ; SSE2: ## %bb.0: ; SSE2-NEXT: movmskps %xmm1, %eax ; SSE2-NEXT: testb $1, %al ; SSE2-NEXT: jne LBB26_1 ; SSE2-NEXT: ## %bb.2: ## %else ; SSE2-NEXT: testb $2, %al ; SSE2-NEXT: jne LBB26_3 ; SSE2-NEXT: LBB26_4: ## %else2 ; SSE2-NEXT: testb $4, %al ; SSE2-NEXT: jne LBB26_5 ; SSE2-NEXT: LBB26_6: ## %else4 ; SSE2-NEXT: testb $8, %al ; SSE2-NEXT: jne LBB26_7 ; SSE2-NEXT: LBB26_8: ## %else6 ; SSE2-NEXT: retq ; SSE2-NEXT: LBB26_1: ## %cond.store ; SSE2-NEXT: movss %xmm0, (%rdi) ; SSE2-NEXT: testb $2, %al ; SSE2-NEXT: je LBB26_4 ; SSE2-NEXT: LBB26_3: ## %cond.store1 ; SSE2-NEXT: movaps %xmm0, %xmm1 ; SSE2-NEXT: shufps {{.*#+}} xmm1 = xmm1[1,1],xmm0[1,1] ; SSE2-NEXT: movss %xmm1, 4(%rdi) ; SSE2-NEXT: testb $4, %al ; SSE2-NEXT: je LBB26_6 ; SSE2-NEXT: LBB26_5: ## %cond.store3 ; SSE2-NEXT: movaps %xmm0, %xmm1 ; SSE2-NEXT: unpckhpd {{.*#+}} xmm1 = xmm1[1],xmm0[1] ; SSE2-NEXT: movss %xmm1, 8(%rdi) ; SSE2-NEXT: testb $8, %al ; SSE2-NEXT: je LBB26_8 ; SSE2-NEXT: LBB26_7: ## %cond.store5 ; SSE2-NEXT: shufps {{.*#+}} xmm0 = xmm0[3,3,3,3] ; SSE2-NEXT: movss %xmm0, 12(%rdi) ; SSE2-NEXT: retq ; ; SSE4-LABEL: one_mask_bit_set1_variable: ; SSE4: ## %bb.0: ; SSE4-NEXT: movmskps %xmm1, %eax ; SSE4-NEXT: testb $1, %al ; SSE4-NEXT: jne LBB26_1 ; SSE4-NEXT: ## %bb.2: ## %else ; SSE4-NEXT: testb $2, %al ; SSE4-NEXT: jne LBB26_3 ; SSE4-NEXT: LBB26_4: ## %else2 ; SSE4-NEXT: testb $4, %al ; SSE4-NEXT: jne LBB26_5 ; SSE4-NEXT: LBB26_6: ## %else4 ; SSE4-NEXT: testb $8, %al ; SSE4-NEXT: jne LBB26_7 ; SSE4-NEXT: LBB26_8: ## %else6 ; SSE4-NEXT: retq ; SSE4-NEXT: LBB26_1: ## %cond.store ; SSE4-NEXT: movss %xmm0, (%rdi) ; SSE4-NEXT: testb $2, %al ; SSE4-NEXT: je LBB26_4 ; SSE4-NEXT: LBB26_3: ## %cond.store1 ; SSE4-NEXT: extractps $1, %xmm0, 4(%rdi) ; SSE4-NEXT: testb $4, %al ; SSE4-NEXT: je LBB26_6 ; SSE4-NEXT: LBB26_5: ## %cond.store3 ; SSE4-NEXT: extractps $2, %xmm0, 8(%rdi) ; SSE4-NEXT: testb $8, %al ; SSE4-NEXT: je LBB26_8 ; SSE4-NEXT: LBB26_7: ## %cond.store5 ; SSE4-NEXT: extractps $3, %xmm0, 12(%rdi) ; SSE4-NEXT: retq ; ; AVX1OR2-LABEL: one_mask_bit_set1_variable: ; AVX1OR2: ## %bb.0: ; AVX1OR2-NEXT: vmaskmovps %xmm0, %xmm1, (%rdi) ; AVX1OR2-NEXT: retq ; ; AVX512F-LABEL: one_mask_bit_set1_variable: ; AVX512F: ## %bb.0: ; AVX512F-NEXT: ## kill: def $xmm1 killed $xmm1 def $zmm1 ; AVX512F-NEXT: ## kill: def $xmm0 killed $xmm0 def $zmm0 ; AVX512F-NEXT: vptestmd {{.*}}(%rip){1to16}, %zmm1, %k0 ; AVX512F-NEXT: kshiftlw $12, %k0, %k0 ; AVX512F-NEXT: kshiftrw $12, %k0, %k1 ; AVX512F-NEXT: vmovups %zmm0, (%rdi) {%k1} ; AVX512F-NEXT: vzeroupper ; AVX512F-NEXT: retq ; ; AVX512VL-LABEL: one_mask_bit_set1_variable: ; AVX512VL: ## %bb.0: ; AVX512VL-NEXT: vptestmd {{.*}}(%rip){1to4}, %xmm1, %k1 ; AVX512VL-NEXT: vmovups %xmm0, (%rdi) {%k1} ; AVX512VL-NEXT: retq ; ; X86-AVX512-LABEL: one_mask_bit_set1_variable: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vptestmd LCPI26_0{1to4}, %xmm1, %k1 ; X86-AVX512-NEXT: vmovups %xmm0, (%eax) {%k1} ; X86-AVX512-NEXT: retl %mask_signbit = and <4 x i32> %mask, %mask_bool = icmp ne <4 x i32> %mask_signbit, zeroinitializer call void @llvm.masked.store.v4f32.p0v4f32(<4 x float> %val, <4 x float>* %addr, i32 1, <4 x i1> %mask_bool) ret void } ; This needs to be widened to v4i32. ; This used to assert in type legalization. PR38436 ; FIXME: The codegen for AVX512 should use KSHIFT to zero the upper bits of the mask. define void @widen_masked_store(<3 x i32> %v, <3 x i32>* %p, <3 x i1> %mask) { ; SSE2-LABEL: widen_masked_store: ; SSE2: ## %bb.0: ; SSE2-NEXT: andb $1, %sil ; SSE2-NEXT: andb $1, %dl ; SSE2-NEXT: addb %dl, %dl ; SSE2-NEXT: orb %sil, %dl ; SSE2-NEXT: andb $1, %cl ; SSE2-NEXT: shlb $2, %cl ; SSE2-NEXT: orb %dl, %cl ; SSE2-NEXT: testb $1, %cl ; SSE2-NEXT: jne LBB27_1 ; SSE2-NEXT: ## %bb.2: ## %else ; SSE2-NEXT: testb $2, %cl ; SSE2-NEXT: jne LBB27_3 ; SSE2-NEXT: LBB27_4: ## %else2 ; SSE2-NEXT: testb $4, %cl ; SSE2-NEXT: jne LBB27_5 ; SSE2-NEXT: LBB27_6: ## %else4 ; SSE2-NEXT: retq ; SSE2-NEXT: LBB27_1: ## %cond.store ; SSE2-NEXT: movd %xmm0, (%rdi) ; SSE2-NEXT: testb $2, %cl ; SSE2-NEXT: je LBB27_4 ; SSE2-NEXT: LBB27_3: ## %cond.store1 ; SSE2-NEXT: pshufd {{.*#+}} xmm1 = xmm0[1,1,1,1] ; SSE2-NEXT: movd %xmm1, 4(%rdi) ; SSE2-NEXT: testb $4, %cl ; SSE2-NEXT: je LBB27_6 ; SSE2-NEXT: LBB27_5: ## %cond.store3 ; SSE2-NEXT: pshufd {{.*#+}} xmm0 = xmm0[2,3,2,3] ; SSE2-NEXT: movd %xmm0, 8(%rdi) ; SSE2-NEXT: retq ; ; SSE4-LABEL: widen_masked_store: ; SSE4: ## %bb.0: ; SSE4-NEXT: andb $1, %sil ; SSE4-NEXT: andb $1, %dl ; SSE4-NEXT: addb %dl, %dl ; SSE4-NEXT: orb %sil, %dl ; SSE4-NEXT: andb $1, %cl ; SSE4-NEXT: shlb $2, %cl ; SSE4-NEXT: orb %dl, %cl ; SSE4-NEXT: testb $1, %cl ; SSE4-NEXT: jne LBB27_1 ; SSE4-NEXT: ## %bb.2: ## %else ; SSE4-NEXT: testb $2, %cl ; SSE4-NEXT: jne LBB27_3 ; SSE4-NEXT: LBB27_4: ## %else2 ; SSE4-NEXT: testb $4, %cl ; SSE4-NEXT: jne LBB27_5 ; SSE4-NEXT: LBB27_6: ## %else4 ; SSE4-NEXT: retq ; SSE4-NEXT: LBB27_1: ## %cond.store ; SSE4-NEXT: movss %xmm0, (%rdi) ; SSE4-NEXT: testb $2, %cl ; SSE4-NEXT: je LBB27_4 ; SSE4-NEXT: LBB27_3: ## %cond.store1 ; SSE4-NEXT: extractps $1, %xmm0, 4(%rdi) ; SSE4-NEXT: testb $4, %cl ; SSE4-NEXT: je LBB27_6 ; SSE4-NEXT: LBB27_5: ## %cond.store3 ; SSE4-NEXT: extractps $2, %xmm0, 8(%rdi) ; SSE4-NEXT: retq ; ; AVX1-LABEL: widen_masked_store: ; AVX1: ## %bb.0: ; AVX1-NEXT: vmovd %edx, %xmm1 ; AVX1-NEXT: vmovd %esi, %xmm2 ; AVX1-NEXT: vpunpckldq {{.*#+}} xmm1 = xmm2[0],xmm1[0],xmm2[1],xmm1[1] ; AVX1-NEXT: vmovd %ecx, %xmm2 ; AVX1-NEXT: vpunpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm2[0] ; AVX1-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX1-NEXT: vmaskmovps %xmm0, %xmm1, (%rdi) ; AVX1-NEXT: retq ; ; AVX2-LABEL: widen_masked_store: ; AVX2: ## %bb.0: ; AVX2-NEXT: vmovd %edx, %xmm1 ; AVX2-NEXT: vmovd %esi, %xmm2 ; AVX2-NEXT: vpunpckldq {{.*#+}} xmm1 = xmm2[0],xmm1[0],xmm2[1],xmm1[1] ; AVX2-NEXT: vmovd %ecx, %xmm2 ; AVX2-NEXT: vpunpcklqdq {{.*#+}} xmm1 = xmm1[0],xmm2[0] ; AVX2-NEXT: vpslld $31, %xmm1, %xmm1 ; AVX2-NEXT: vpmaskmovd %xmm0, %xmm1, (%rdi) ; AVX2-NEXT: retq ; ; AVX512F-LABEL: widen_masked_store: ; AVX512F: ## %bb.0: ; AVX512F-NEXT: ## kill: def $xmm0 killed $xmm0 def $zmm0 ; AVX512F-NEXT: movw $-3, %ax ; AVX512F-NEXT: kmovw %eax, %k0 ; AVX512F-NEXT: andl $1, %esi ; AVX512F-NEXT: kmovw %esi, %k1 ; AVX512F-NEXT: kandw %k0, %k1, %k0 ; AVX512F-NEXT: kmovw %edx, %k1 ; AVX512F-NEXT: kshiftlw $15, %k1, %k1 ; AVX512F-NEXT: kshiftrw $14, %k1, %k1 ; AVX512F-NEXT: korw %k1, %k0, %k0 ; AVX512F-NEXT: movw $-5, %ax ; AVX512F-NEXT: kmovw %eax, %k1 ; AVX512F-NEXT: kandw %k1, %k0, %k0 ; AVX512F-NEXT: kmovw %ecx, %k1 ; AVX512F-NEXT: kshiftlw $15, %k1, %k1 ; AVX512F-NEXT: kshiftrw $13, %k1, %k1 ; AVX512F-NEXT: korw %k1, %k0, %k0 ; AVX512F-NEXT: kshiftlw $12, %k0, %k0 ; AVX512F-NEXT: kshiftrw $12, %k0, %k1 ; AVX512F-NEXT: vmovdqu32 %zmm0, (%rdi) {%k1} ; AVX512F-NEXT: vzeroupper ; AVX512F-NEXT: retq ; ; AVX512VLDQ-LABEL: widen_masked_store: ; AVX512VLDQ: ## %bb.0: ; AVX512VLDQ-NEXT: movb $-3, %al ; AVX512VLDQ-NEXT: kmovw %eax, %k0 ; AVX512VLDQ-NEXT: kmovw %esi, %k1 ; AVX512VLDQ-NEXT: kshiftlb $7, %k1, %k1 ; AVX512VLDQ-NEXT: kshiftrb $7, %k1, %k1 ; AVX512VLDQ-NEXT: kandw %k0, %k1, %k0 ; AVX512VLDQ-NEXT: kmovw %edx, %k1 ; AVX512VLDQ-NEXT: kshiftlb $7, %k1, %k1 ; AVX512VLDQ-NEXT: kshiftrb $6, %k1, %k1 ; AVX512VLDQ-NEXT: korw %k1, %k0, %k0 ; AVX512VLDQ-NEXT: movb $-5, %al ; AVX512VLDQ-NEXT: kmovw %eax, %k1 ; AVX512VLDQ-NEXT: kandw %k1, %k0, %k0 ; AVX512VLDQ-NEXT: kmovw %ecx, %k1 ; AVX512VLDQ-NEXT: kshiftlb $7, %k1, %k1 ; AVX512VLDQ-NEXT: kshiftrb $5, %k1, %k1 ; AVX512VLDQ-NEXT: korw %k1, %k0, %k1 ; AVX512VLDQ-NEXT: vmovdqa32 %xmm0, (%rdi) {%k1} ; AVX512VLDQ-NEXT: retq ; ; AVX512VLBW-LABEL: widen_masked_store: ; AVX512VLBW: ## %bb.0: ; AVX512VLBW-NEXT: movw $-3, %ax ; AVX512VLBW-NEXT: kmovd %eax, %k0 ; AVX512VLBW-NEXT: andl $1, %esi ; AVX512VLBW-NEXT: kmovw %esi, %k1 ; AVX512VLBW-NEXT: kandw %k0, %k1, %k0 ; AVX512VLBW-NEXT: kmovd %edx, %k1 ; AVX512VLBW-NEXT: kshiftlw $15, %k1, %k1 ; AVX512VLBW-NEXT: kshiftrw $14, %k1, %k1 ; AVX512VLBW-NEXT: korw %k1, %k0, %k0 ; AVX512VLBW-NEXT: movw $-5, %ax ; AVX512VLBW-NEXT: kmovd %eax, %k1 ; AVX512VLBW-NEXT: kandw %k1, %k0, %k0 ; AVX512VLBW-NEXT: kmovd %ecx, %k1 ; AVX512VLBW-NEXT: kshiftlw $15, %k1, %k1 ; AVX512VLBW-NEXT: kshiftrw $13, %k1, %k1 ; AVX512VLBW-NEXT: korw %k1, %k0, %k1 ; AVX512VLBW-NEXT: vmovdqa32 %xmm0, (%rdi) {%k1} ; AVX512VLBW-NEXT: retq ; ; X86-AVX512-LABEL: widen_masked_store: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: movb $-3, %al ; X86-AVX512-NEXT: kmovd %eax, %k0 ; X86-AVX512-NEXT: kmovb {{[0-9]+}}(%esp), %k1 ; X86-AVX512-NEXT: kshiftlb $7, %k1, %k1 ; X86-AVX512-NEXT: kshiftrb $7, %k1, %k1 ; X86-AVX512-NEXT: kandw %k0, %k1, %k0 ; X86-AVX512-NEXT: kmovb {{[0-9]+}}(%esp), %k1 ; X86-AVX512-NEXT: kshiftlb $7, %k1, %k1 ; X86-AVX512-NEXT: kshiftrb $6, %k1, %k1 ; X86-AVX512-NEXT: korw %k1, %k0, %k0 ; X86-AVX512-NEXT: movb $-5, %al ; X86-AVX512-NEXT: kmovd %eax, %k1 ; X86-AVX512-NEXT: kandw %k1, %k0, %k0 ; X86-AVX512-NEXT: kmovb {{[0-9]+}}(%esp), %k1 ; X86-AVX512-NEXT: kshiftlb $7, %k1, %k1 ; X86-AVX512-NEXT: kshiftrb $5, %k1, %k1 ; X86-AVX512-NEXT: korw %k1, %k0, %k1 ; X86-AVX512-NEXT: movl {{[0-9]+}}(%esp), %eax ; X86-AVX512-NEXT: vmovdqa32 %xmm0, (%eax) {%k1} ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v3i32.p0v3i32(<3 x i32> %v, <3 x i32>* %p, i32 16, <3 x i1> %mask) ret void } define void @zero_mask(<2 x double>* %addr, <2 x double> %val) { ; SSE-LABEL: zero_mask: ; SSE: ## %bb.0: ; SSE-NEXT: retq ; ; AVX-LABEL: zero_mask: ; AVX: ## %bb.0: ; AVX-NEXT: retq ; ; X86-AVX512-LABEL: zero_mask: ; X86-AVX512: ## %bb.0: ; X86-AVX512-NEXT: retl call void @llvm.masked.store.v2f64.p0v2f64(<2 x double> %val, <2 x double>* %addr, i32 4, <2 x i1> zeroinitializer) ret void } define void @PR11210(<4 x float> %x, <4 x float>* %ptr, <4 x float> %y, <2 x i64> %mask) { ; SSE2-LABEL: PR11210: ; SSE2: ## %bb.0: ; SSE2-NEXT: movmskps %xmm2, %eax ; SSE2-NEXT: testb $1, %al ; SSE2-NEXT: jne LBB29_1 ; SSE2-NEXT: ## %bb.2: ## %else ; SSE2-NEXT: testb $2, %al ; SSE2-NEXT: jne LBB29_3 ; SSE2-NEXT: LBB29_4: ## %else2 ; SSE2-NEXT: testb $4, %al ; SSE2-NEXT: jne LBB29_5 ; SSE2-NEXT: LBB29_6: ## %else4 ; SSE2-NEXT: testb $8, %al ; SSE2-NEXT: jne LBB29_7 ; SSE2-NEXT: LBB29_8: ## %else6 ; SSE2-NEXT: testb $1, %al ; SSE2-NEXT: jne LBB29_9 ; SSE2-NEXT: LBB29_10: ## %else9 ; SSE2-NEXT: testb $2, %al ; SSE2-NEXT: jne LBB29_11 ; SSE2-NEXT: LBB29_12: ## %else11 ; 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