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Searched refs:D18 (Results 1 – 25 of 111) sorted by relevance

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/external/icu/icu4c/source/test/letest/
Dletest.sln5 Project("{8BC9CEB8-8B4A-11D0-8D11-00A0C91BC942}") = "letest", "letest.vcxproj", "{67351485-4D18-424…
20 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Debug|Win32.ActiveCfg = Debug|Win32
21 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Debug|Win32.Build.0 = Debug|Win32
22 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Debug|x64.ActiveCfg = Debug|x64
23 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Debug|x64.Build.0 = Debug|x64
24 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Release|Win32.ActiveCfg = Release|Win32
25 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Release|Win32.Build.0 = Release|Win32
26 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Release|x64.ActiveCfg = Release|x64
27 {67351485-4D18-4245-BE39-A7EF0675ACD2}.Release|x64.Build.0 = Release|x64
/external/libxaac/decoder/armv7/
Dixheaacd_overlap_add1.s116 VUZP.16 D18, D19
132 VST1.16 D18[0], [R6], R9
134 VST1.16 D18[1], [R6], R9
136 VST1.16 D18[2], [R6], R9
138 VST1.16 D18[3], [R6], R9
178 VUZP.16 D18, D19
186 VST1.16 D18[0], [R6], R9
188 VST1.16 D18[1], [R6], R9
190 VST1.16 D18[2], [R6], R9
200 VST1.16 D18[3], [R6], R9
[all …]
Dixheaacd_esbr_qmfsyn64_winadd.s74 VLD1.32 {D18, D19}, [R2], R9
76 VMLAL.S32 Q13, D16, D18
112 VLD1.32 {D18, D19}, [R12], R9
114 VMLAL.S32 Q13, D16, D18
167 VLD1.32 {D18, D19}, [R2], R9
169 VMLAL.S32 Q13, D16, D18
205 VLD1.32 {D18, D19}, [R12], R9
207 VMLAL.S32 Q13, D16, D18
256 VLD1.32 {D18, D19}, [R2], R9
258 VMLAL.S32 Q13, D16, D18
[all …]
Dixheaacd_post_twiddle_overlap.s45 VMOV.S16 D18, #50
249 VMULL.U16 Q1, D24, D18
251 VMULL.U16 Q0, D26, D18
258 VMLAL.S16 Q1, D25, D18
259 VMLAL.S16 Q0, D27, D18
299 VMULL.U16 Q4, D24, D18
300 VMULL.U16 Q13, D22, D18
313 VMLAL.S16 Q4, D25, D18
314 VMLAL.S16 Q13, D23, D18
506 VMULL.U16 Q1, D24, D18
[all …]
Dixheaacd_sbr_qmfanal32_winadds.s147 VLD2.16 {D17, D18}, [R3]!
151 VLD1.16 D18, [R1], R6
183 VMLAL.S16 Q15, D18, D19
238 VLD2.16 {D17, D18}, [R3]!
242 VLD1.16 D18, [R1], R6
260 VMLAL.S16 Q15, D18, D19
Dixheaacd_dec_DCT2_64_asm.s104 VUZP.16 D18, D19
106 VMLSL.U16 Q15, D18, D10
107 VMULL.U16 Q14, D18, D8
157 VUZP.16 D18, D19
162 VMLSL.U16 Q15, D18, D10
164 VMULL.U16 Q14, D18, D8
200 VUZP.16 D18, D19
202 VMLSL.U16 Q15, D18, D10
204 VMULL.U16 Q14, D18, D8
259 VUZP.16 D18, D19
[all …]
Dixheaacd_sbr_qmfsyn64_winadd.s113 VLD1.16 D18, [R1], R8
118 VMLAL.S16 Q13, D19, D18
177 VLD1.16 D18, [R1], R8
217 VMLAL.S16 Q13, D19, D18
268 VLD1.16 D18, [R1], R8
274 VMLAL.S16 Q13, D19, D18
334 VLD1.16 D18, [R1], R8
364 VMLAL.S16 Q13, D19, D18
Dixheaacd_sbr_qmfanal32_winadds_eld.s128 VLD1.16 {D17, D18}, [R3]! @ tmpQmf_c2[2*(n + 192)] load and incremented
132 VLD1.16 D18, [R1], R6
164 VMLAL.S16 Q15, D18, D19
221 VLD1.16 {D17, D18}, [R3]!
225 VLD1.16 D18, [R1], R6
243 VMLAL.S16 Q15, D18, D19
Dixheaacd_post_twiddle.s178 VUZP.16 D18, D19
184 VMULL.U16 Q2, D18, D10
286 VUZP.16 D18, D19
292 VMULL.U16 Q2, D18, D10
386 VUZP.16 D18, D19
392 VMULL.U16 Q2, D18, D10
502 VUZP.16 D18, D19
508 VMULL.U16 Q2, D18, D10
Dixheaacd_calc_pre_twid.s62 VSHRN.S64 D18, Q9, #32
69 VSUB.I32 D2, D16, D18
Dixheaacd_tns_ar_filter_fixed.s115 VLD1.32 {D18, D19}, [R8]!
182 VMLAL.S32 Q1, D22, D18
224 VMLAL.S32 Q1, D22, D18
268 VMLAL.S32 Q1, D22, D18
314 VMLAL.S32 Q1, D22, D18
407 VLD1.32 {D18, D19}, [R8]!
471 VMLAL.S32 Q1, D22, D18
516 VMLAL.S32 Q1, D22, D18
/external/libhevc/common/arm/
Dihevc_sao_band_offset_chroma.s249 VCLE.U8 D18,D11,D29 @vcle_u8(band_table.val[2], vdup_n_u8(16))
251 VORR.U8 D11,D11,D18 @band_table.val[2] = vorr_u8(band_table.val[2], au1_cmp)
263 VAND.U8 D11,D11,D18 @band_table.val[2] = vand_u8(band_table.val[2], au1_cmp)
301 VLD2.8 {D17,D18},[r6] @vld1q_u8(pu1_src_cpy)
314 VSUB.I8 D20,D18,D30 @vsub_u8(au1_cur_row_deint.val[1], band_pos_v)
327 …VTBX.8 D18,{D9-D12},D20 @vtbx4_u8(au1_cur_row_deint.val[1], band_table_v, vsub_u8(…
331 VST2.8 {D17,D18},[r6],r1 @vst1q_u8(pu1_src_cpy, au1_cur_row)
355 VLD2.8 {D17,D18},[r6] @vld1q_u8(pu1_src_cpy)
368 VSUB.I8 D20,D18,D30 @vsub_u8(au1_cur_row_deint.val[1], band_pos_v)
379 …VTBX.8 D18,{D9-D12},D20 @vtbx4_u8(au1_cur_row_deint.val[1], band_table_v, vsub_u8(…
[all …]
Dihevc_sao_edge_offset_class1.s152 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
166 …VMOVL.U8 Q13,D18 @II pi2_tmp_cur_row.val[0] = vreinterpretq_s16_u16(vmovl_u…
233 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
294 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
308 …VMOVL.U8 Q13,D18 @II pi2_tmp_cur_row.val[0] = vreinterpretq_s16_u16(vmovl_u…
352 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
Dihevc_sao_edge_offset_class2.s284 …VMOV.8 D18[0],r5 @I pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd +…
309 VTBL.8 D18,{D6},D24 @I vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
315 VTBL.8 D10,{D7},D18 @I offset = vtbl1_s8(offset_tbl, vget_low_s8(edge_idx))
362 …VMOV.8 D18[0],r8 @III pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd…
406 VTBL.8 D18,{D6},D18 @III vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
417 … VTBL.8 D10,{D7},D18 @III offset = vtbl1_s8(offset_tbl, vget_low_s8(edge_idx))
463 …VMOV.8 D18[0],r5 @pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd + 1…
482 VTBL.8 D18,{D6},D18 @vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
490 VTBL.8 D10,{D7},D18 @offset = vtbl1_s8(offset_tbl, vget_low_s8(edge_idx))
595 …VMOV.8 D18[0],r5 @pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd + 1…
Dihevc_sao_edge_offset_class1_chroma.s156 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
170 …VMOVL.U8 Q13,D18 @II pi2_tmp_cur_row.val[0] = vreinterpretq_s16_u16(vmovl_u…
245 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
311 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
325 …VMOVL.U8 Q13,D18 @II pi2_tmp_cur_row.val[0] = vreinterpretq_s16_u16(vmovl_u…
382 VLD1.8 D18,[r10]! @pu1_next_row = vld1q_u8(pu1_src_cpy + src_strd)
Dihevc_sao_edge_offset_class3_chroma.s411 VTBL.8 D18,{D28},D18 @I vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
420 VUZP.8 D18,D19 @I
421 VTBL.8 D22,{D6},D18 @I
547 VTBL.8 D18,{D20},D18 @III vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
558 VUZP.8 D18,D19 @III
561 VTBL.8 D22,{D6},D18 @III
645 VTBL.8 D18,{D28},D18 @vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
651 VUZP.8 D18,D19
653 VTBL.8 D22,{D6},D18
Dihevc_resi_trans_32x32_a9q.s227 VSWP D18, D19 @ Q9: e[16] e[15] e[14] e[13] e[12] e[11] e[10] e[9]
301 VST1.32 D18,[R2],R10 @ -- dual issued
333 VSWP D18,D31 @R1 transpose2
389 VSWP D18, D5 @ R1
417 VST1.32 D18,[R2],R7
459 VSWP D18, D1 @ R1
499 VST1.32 D18,[R2],R7 @1st cycle dual issue
542 VSWP D18, D3 @ R2
578 VST1.32 D18, [R2], R7 @ 1st cycle dual issued
623 VSWP D18, D3 @ R2
[all …]
Dihevc_sao_edge_offset_class2_chroma.s378 …VMOV.16 D18[0],r5 @I pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd +…
420 VTBL.8 D18,{D30},D18 @I vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
474 …VMOV.16 D18[0],r4 @III pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd…
556 VTBL.8 D18,{D20},D18 @III vtbl1_s8(edge_idx_tbl, vget_low_s8(edge_idx))
565 VUZP.8 D18,D19 @III
566 VTBL.8 D22,{D6},D18 @III
612 …VMOV.16 D18[0],r5 @pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd + 1…
757 …VMOV.16 D18[0],r5 @pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd + 1…
907 …VMOV.16 D18[0],r5 @pu1_next_row_tmp = vsetq_lane_u8(pu1_src_cpy[src_strd + 1…
Dihevc_sao_band_offset_luma.s213 VSUB.I8 D18,D17,D31 @vsub_u8(au1_cur_row, band_pos)
215 …VTBX.8 D17,{D1-D4},D18 @vtbx4_u8(au1_cur_row, band_table, vsub_u8(au1_cur_row, ba…
Dihevc_resi_trans.s1236 VMULL.S16 Q6,D18,D4 @o[0][0-3]* R1
1253 VMULL.S16 Q8,D18,D4 @o[1][0-3]* R1
1270 VMULL.S16 Q12,D18,D4 @o[2][0-3]* R1
1273 VMULL.S16 Q0,D18,D6 @o[3][0-3]* R1
1307 VMULL.S16 Q3,D18,D4 @o[4][0-3]* R1
1322 VMULL.S16 Q5,D18,D4 @o[5][0-3]* R1
1336 VMULL.S16 Q7,D18,D4 @o[6][0-3]* R1
1339 VMULL.S16 Q10,D18,D2 @o[7][0-3]* R1
1468 VSWP D18,D19 @ dual issued with prev. instruction
1542 VPADD.S32 D18,D24,D25 @D18[0] -> 2G0*R1E00+2G1*R1E01 2G2*R2E02+2G3*R2E03
[all …]
/external/llvm-project/llvm/test/MC/MachO/
Dx86_64-symbols.s59 D18: label
Dx86_32-symbols.s59 D18: label
/external/llvm/test/MC/MachO/
Dx86_64-symbols.s59 D18: label
Dx86_32-symbols.s59 D18: label
/external/llvm-project/llvm/test/DebugInfo/MIR/ARM/
Dsubregister-full-piece.mir38 # CHECK: DW_AT_location (DW_OP_regx D18, DW_OP_piece 0x7)

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