1 /* 2 * Copyright (c) 2015-2019, Renesas Electronics Corporation. All rights reserved. 3 * 4 * SPDX-License-Identifier: BSD-3-Clause 5 */ 6 #ifndef PFC_REGS_H 7 #define PFC_REGS_H 8 9 /* GPIO base address */ 10 #define GPIO_BASE (0xE6050000U) 11 12 /* GPIO registers */ 13 #define GPIO_IOINTSEL0 (GPIO_BASE + 0x0000U) 14 #define GPIO_INOUTSEL0 (GPIO_BASE + 0x0004U) 15 #define GPIO_OUTDT0 (GPIO_BASE + 0x0008U) 16 #define GPIO_INDT0 (GPIO_BASE + 0x000CU) 17 #define GPIO_INTDT0 (GPIO_BASE + 0x0010U) 18 #define GPIO_INTCLR0 (GPIO_BASE + 0x0014U) 19 #define GPIO_INTMSK0 (GPIO_BASE + 0x0018U) 20 #define GPIO_MSKCLR0 (GPIO_BASE + 0x001CU) 21 #define GPIO_POSNEG0 (GPIO_BASE + 0x0020U) 22 #define GPIO_EDGLEVEL0 (GPIO_BASE + 0x0024U) 23 #define GPIO_FILONOFF0 (GPIO_BASE + 0x0028U) 24 #define GPIO_INTMSKS0 (GPIO_BASE + 0x0038U) 25 #define GPIO_MSKCLRS0 (GPIO_BASE + 0x003CU) 26 #define GPIO_OUTDTSEL0 (GPIO_BASE + 0x0040U) 27 #define GPIO_OUTDTH0 (GPIO_BASE + 0x0044U) 28 #define GPIO_OUTDTL0 (GPIO_BASE + 0x0048U) 29 #define GPIO_BOTHEDGE0 (GPIO_BASE + 0x004CU) 30 #define GPIO_IOINTSEL1 (GPIO_BASE + 0x1000U) 31 #define GPIO_INOUTSEL1 (GPIO_BASE + 0x1004U) 32 #define GPIO_OUTDT1 (GPIO_BASE + 0x1008U) 33 #define GPIO_INDT1 (GPIO_BASE + 0x100CU) 34 #define GPIO_INTDT1 (GPIO_BASE + 0x1010U) 35 #define GPIO_INTCLR1 (GPIO_BASE + 0x1014U) 36 #define GPIO_INTMSK1 (GPIO_BASE + 0x1018U) 37 #define GPIO_MSKCLR1 (GPIO_BASE + 0x101CU) 38 #define GPIO_POSNEG1 (GPIO_BASE + 0x1020U) 39 #define GPIO_EDGLEVEL1 (GPIO_BASE + 0x1024U) 40 #define GPIO_FILONOFF1 (GPIO_BASE + 0x1028U) 41 #define GPIO_INTMSKS1 (GPIO_BASE + 0x1038U) 42 #define GPIO_MSKCLRS1 (GPIO_BASE + 0x103CU) 43 #define GPIO_OUTDTSEL1 (GPIO_BASE + 0x1040U) 44 #define GPIO_OUTDTH1 (GPIO_BASE + 0x1044U) 45 #define GPIO_OUTDTL1 (GPIO_BASE + 0x1048U) 46 #define GPIO_BOTHEDGE1 (GPIO_BASE + 0x104CU) 47 #define GPIO_IOINTSEL2 (GPIO_BASE + 0x2000U) 48 #define GPIO_INOUTSEL2 (GPIO_BASE + 0x2004U) 49 #define GPIO_OUTDT2 (GPIO_BASE + 0x2008U) 50 #define GPIO_INDT2 (GPIO_BASE + 0x200CU) 51 #define GPIO_INTDT2 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#define GPIO_EDGLEVEL3 (GPIO_BASE + 0x3024U) 74 #define GPIO_FILONOFF3 (GPIO_BASE + 0x3028U) 75 #define GPIO_INTMSKS3 (GPIO_BASE + 0x3038U) 76 #define GPIO_MSKCLRS3 (GPIO_BASE + 0x303CU) 77 #define GPIO_OUTDTSEL3 (GPIO_BASE + 0x3040U) 78 #define GPIO_OUTDTH3 (GPIO_BASE + 0x3044U) 79 #define GPIO_OUTDTL3 (GPIO_BASE + 0x3048U) 80 #define GPIO_BOTHEDGE3 (GPIO_BASE + 0x304CU) 81 #define GPIO_IOINTSEL4 (GPIO_BASE + 0x4000U) 82 #define GPIO_INOUTSEL4 (GPIO_BASE + 0x4004U) 83 #define GPIO_OUTDT4 (GPIO_BASE + 0x4008U) 84 #define GPIO_INDT4 (GPIO_BASE + 0x400CU) 85 #define GPIO_INTDT4 (GPIO_BASE + 0x4010U) 86 #define GPIO_INTCLR4 (GPIO_BASE + 0x4014U) 87 #define GPIO_INTMSK4 (GPIO_BASE + 0x4018U) 88 #define GPIO_MSKCLR4 (GPIO_BASE + 0x401CU) 89 #define GPIO_POSNEG4 (GPIO_BASE + 0x4020U) 90 #define GPIO_EDGLEVEL4 (GPIO_BASE + 0x4024U) 91 #define GPIO_FILONOFF4 (GPIO_BASE + 0x4028U) 92 #define GPIO_INTMSKS4 (GPIO_BASE + 0x4038U) 93 #define GPIO_MSKCLRS4 (GPIO_BASE + 0x403CU) 94 #define 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GPIO_INTCLR7 (GPIO_BASE + 0x5814U) 137 #define GPIO_INTMSK7 (GPIO_BASE + 0x5818U) 138 #define GPIO_MSKCLR7 (GPIO_BASE + 0x581CU) 139 #define GPIO_POSNEG7 (GPIO_BASE + 0x5820U) 140 #define GPIO_EDGLEVEL7 (GPIO_BASE + 0x5824U) 141 #define GPIO_FILONOFF7 (GPIO_BASE + 0x5828U) 142 #define GPIO_INTMSKS7 (GPIO_BASE + 0x5838U) 143 #define GPIO_MSKCLRS7 (GPIO_BASE + 0x583CU) 144 #define GPIO_OUTDTSEL7 (GPIO_BASE + 0x5840U) 145 #define GPIO_OUTDTH7 (GPIO_BASE + 0x5844U) 146 #define GPIO_OUTDTL7 (GPIO_BASE + 0x5848U) 147 #define GPIO_BOTHEDGE7 (GPIO_BASE + 0x584CU) 148 149 /* Pin functon base address */ 150 #define PFC_BASE (0xE6060000U) 151 152 /* Pin functon registers */ 153 #define PFC_PMMR (PFC_BASE + 0x0000U) 154 #define PFC_GPSR0 (PFC_BASE + 0x0100U) 155 #define PFC_GPSR1 (PFC_BASE + 0x0104U) 156 #define PFC_GPSR2 (PFC_BASE + 0x0108U) 157 #define PFC_GPSR3 (PFC_BASE + 0x010CU) 158 #define PFC_GPSR4 (PFC_BASE + 0x0110U) 159 #define PFC_GPSR5 (PFC_BASE + 0x0114U) 160 #define PFC_GPSR6 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PFC_MOD_SEL1 (PFC_BASE + 0x0504U) 228 #define PFC_MOD_SEL2 (PFC_BASE + 0x0508U) 229 230 #endif /* PFC_REGS_H */ 231