1 /* 2 * Common header file for blackfin family of processors. 3 * 4 */ 5 6 #ifndef _PORTMUX_H_ 7 #define _PORTMUX_H_ 8 9 #define P_IDENT(x) ((x) & 0x1FF) 10 #define P_FUNCT(x) (((x) & 0x3) << 9) 11 #define P_FUNCT2MUX(x) (((x) >> 9) & 0x3) 12 #define P_DEFINED 0x8000 13 #define P_UNDEF 0x4000 14 #define P_MAYSHARE 0x2000 15 #define P_DONTCARE 0x1000 16 17 18 int peripheral_request(unsigned short per, const char *label); 19 void peripheral_free(unsigned short per); 20 int peripheral_request_list(const unsigned short per[], const char *label); 21 void peripheral_free_list(const unsigned short per[]); 22 23 #include <asm/gpio.h> 24 #include <mach/portmux.h> 25 26 #ifndef P_SPORT2_TFS 27 #define P_SPORT2_TFS P_UNDEF 28 #endif 29 30 #ifndef P_SPORT2_DTSEC 31 #define P_SPORT2_DTSEC P_UNDEF 32 #endif 33 34 #ifndef P_SPORT2_DTPRI 35 #define P_SPORT2_DTPRI P_UNDEF 36 #endif 37 38 #ifndef P_SPORT2_TSCLK 39 #define P_SPORT2_TSCLK P_UNDEF 40 #endif 41 42 #ifndef P_SPORT2_RFS 43 #define P_SPORT2_RFS P_UNDEF 44 #endif 45 46 #ifndef P_SPORT2_DRSEC 47 #define P_SPORT2_DRSEC P_UNDEF 48 #endif 49 50 #ifndef P_SPORT2_DRPRI 51 #define P_SPORT2_DRPRI P_UNDEF 52 #endif 53 54 #ifndef P_SPORT2_RSCLK 55 #define P_SPORT2_RSCLK P_UNDEF 56 #endif 57 58 #ifndef P_SPORT3_TFS 59 #define P_SPORT3_TFS P_UNDEF 60 #endif 61 62 #ifndef P_SPORT3_DTSEC 63 #define P_SPORT3_DTSEC P_UNDEF 64 #endif 65 66 #ifndef P_SPORT3_DTPRI 67 #define P_SPORT3_DTPRI P_UNDEF 68 #endif 69 70 #ifndef P_SPORT3_TSCLK 71 #define P_SPORT3_TSCLK P_UNDEF 72 #endif 73 74 #ifndef P_SPORT3_RFS 75 #define P_SPORT3_RFS P_UNDEF 76 #endif 77 78 #ifndef P_SPORT3_DRSEC 79 #define P_SPORT3_DRSEC P_UNDEF 80 #endif 81 82 #ifndef P_SPORT3_DRPRI 83 #define P_SPORT3_DRPRI P_UNDEF 84 #endif 85 86 #ifndef P_SPORT3_RSCLK 87 #define P_SPORT3_RSCLK P_UNDEF 88 #endif 89 90 #ifndef P_TMR4 91 #define P_TMR4 P_UNDEF 92 #endif 93 94 #ifndef P_TMR5 95 #define P_TMR5 P_UNDEF 96 #endif 97 98 #ifndef P_TMR6 99 #define P_TMR6 P_UNDEF 100 #endif 101 102 #ifndef P_TMR7 103 #define P_TMR7 P_UNDEF 104 #endif 105 106 #ifndef P_TWI1_SCL 107 #define P_TWI1_SCL P_UNDEF 108 #endif 109 110 #ifndef P_TWI1_SDA 111 #define P_TWI1_SDA P_UNDEF 112 #endif 113 114 #ifndef P_UART3_RTS 115 #define P_UART3_RTS P_UNDEF 116 #endif 117 118 #ifndef P_UART3_CTS 119 #define P_UART3_CTS P_UNDEF 120 #endif 121 122 #ifndef P_UART2_TX 123 #define P_UART2_TX P_UNDEF 124 #endif 125 126 #ifndef P_UART2_RX 127 #define P_UART2_RX P_UNDEF 128 #endif 129 130 #ifndef P_UART3_TX 131 #define P_UART3_TX P_UNDEF 132 #endif 133 134 #ifndef P_UART3_RX 135 #define P_UART3_RX P_UNDEF 136 #endif 137 138 #ifndef P_SPI2_SS 139 #define P_SPI2_SS P_UNDEF 140 #endif 141 142 #ifndef P_SPI2_SSEL1 143 #define P_SPI2_SSEL1 P_UNDEF 144 #endif 145 146 #ifndef P_SPI2_SSEL2 147 #define P_SPI2_SSEL2 P_UNDEF 148 #endif 149 150 #ifndef P_SPI2_SSEL3 151 #define P_SPI2_SSEL3 P_UNDEF 152 #endif 153 154 #ifndef P_SPI2_SSEL4 155 #define P_SPI2_SSEL4 P_UNDEF 156 #endif 157 158 #ifndef P_SPI2_SSEL5 159 #define P_SPI2_SSEL5 P_UNDEF 160 #endif 161 162 #ifndef P_SPI2_SSEL6 163 #define P_SPI2_SSEL6 P_UNDEF 164 #endif 165 166 #ifndef P_SPI2_SSEL7 167 #define P_SPI2_SSEL7 P_UNDEF 168 #endif 169 170 #ifndef P_SPI2_SCK 171 #define P_SPI2_SCK P_UNDEF 172 #endif 173 174 #ifndef P_SPI2_MOSI 175 #define P_SPI2_MOSI P_UNDEF 176 #endif 177 178 #ifndef P_SPI2_MISO 179 #define P_SPI2_MISO P_UNDEF 180 #endif 181 182 #ifndef P_TMR0 183 #define P_TMR0 P_UNDEF 184 #endif 185 186 #ifndef P_TMR1 187 #define P_TMR1 P_UNDEF 188 #endif 189 190 #ifndef P_TMR2 191 #define P_TMR2 P_UNDEF 192 #endif 193 194 #ifndef P_TMR3 195 #define P_TMR3 P_UNDEF 196 #endif 197 198 #ifndef P_SPORT0_TFS 199 #define P_SPORT0_TFS P_UNDEF 200 #endif 201 202 #ifndef P_SPORT0_DTSEC 203 #define P_SPORT0_DTSEC P_UNDEF 204 #endif 205 206 #ifndef P_SPORT0_DTPRI 207 #define P_SPORT0_DTPRI P_UNDEF 208 #endif 209 210 #ifndef P_SPORT0_TSCLK 211 #define P_SPORT0_TSCLK P_UNDEF 212 #endif 213 214 #ifndef P_SPORT0_RFS 215 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P_PPI1_D3 275 #define P_PPI1_D3 P_UNDEF 276 #endif 277 278 #ifndef P_PPI1_D4 279 #define P_PPI1_D4 P_UNDEF 280 #endif 281 282 #ifndef P_PPI1_D5 283 #define P_PPI1_D5 P_UNDEF 284 #endif 285 286 #ifndef P_PPI1_D6 287 #define P_PPI1_D6 P_UNDEF 288 #endif 289 290 #ifndef P_PPI1_D7 291 #define P_PPI1_D7 P_UNDEF 292 #endif 293 294 #ifndef P_PPI1_D8 295 #define P_PPI1_D8 P_UNDEF 296 #endif 297 298 #ifndef P_PPI1_D9 299 #define P_PPI1_D9 P_UNDEF 300 #endif 301 302 #ifndef P_PPI1_D10 303 #define P_PPI1_D10 P_UNDEF 304 #endif 305 306 #ifndef P_PPI1_D11 307 #define P_PPI1_D11 P_UNDEF 308 #endif 309 310 #ifndef P_PPI1_D12 311 #define P_PPI1_D12 P_UNDEF 312 #endif 313 314 #ifndef P_PPI1_D13 315 #define P_PPI1_D13 P_UNDEF 316 #endif 317 318 #ifndef P_PPI1_D14 319 #define P_PPI1_D14 P_UNDEF 320 #endif 321 322 #ifndef P_PPI1_D15 323 #define P_PPI1_D15 P_UNDEF 324 #endif 325 326 #ifndef P_HOST_D8 327 #define P_HOST_D8 P_UNDEF 328 #endif 329 330 #ifndef P_HOST_D9 331 #define P_HOST_D9 P_UNDEF 332 #endif 333 334 #ifndef P_HOST_D10 335 #define P_HOST_D10 P_UNDEF 336 #endif 337 338 #ifndef P_HOST_D11 339 #define P_HOST_D11 P_UNDEF 340 #endif 341 342 #ifndef P_HOST_D12 343 #define P_HOST_D12 P_UNDEF 344 #endif 345 346 #ifndef P_HOST_D13 347 #define P_HOST_D13 P_UNDEF 348 #endif 349 350 #ifndef P_HOST_D14 351 #define P_HOST_D14 P_UNDEF 352 #endif 353 354 #ifndef P_HOST_D15 355 #define P_HOST_D15 P_UNDEF 356 #endif 357 358 #ifndef P_HOST_D0 359 #define P_HOST_D0 P_UNDEF 360 #endif 361 362 #ifndef P_HOST_D1 363 #define P_HOST_D1 P_UNDEF 364 #endif 365 366 #ifndef P_HOST_D2 367 #define P_HOST_D2 P_UNDEF 368 #endif 369 370 #ifndef P_HOST_D3 371 #define P_HOST_D3 P_UNDEF 372 #endif 373 374 #ifndef P_HOST_D4 375 #define P_HOST_D4 P_UNDEF 376 #endif 377 378 #ifndef P_HOST_D5 379 #define P_HOST_D5 P_UNDEF 380 #endif 381 382 #ifndef P_HOST_D6 383 #define P_HOST_D6 P_UNDEF 384 #endif 385 386 #ifndef P_HOST_D7 387 #define P_HOST_D7 P_UNDEF 388 #endif 389 390 #ifndef P_SPORT1_TFS 391 #define P_SPORT1_TFS P_UNDEF 392 #endif 393 394 #ifndef P_SPORT1_DTSEC 395 #define P_SPORT1_DTSEC P_UNDEF 396 #endif 397 398 #ifndef P_SPORT1_DTPRI 399 #define P_SPORT1_DTPRI P_UNDEF 400 #endif 401 402 #ifndef P_SPORT1_TSCLK 403 #define P_SPORT1_TSCLK P_UNDEF 404 #endif 405 406 #ifndef P_SPORT1_RFS 407 #define P_SPORT1_RFS P_UNDEF 408 #endif 409 410 #ifndef P_SPORT1_DRSEC 411 #define P_SPORT1_DRSEC P_UNDEF 412 #endif 413 414 #ifndef P_SPORT1_DRPRI 415 #define P_SPORT1_DRPRI P_UNDEF 416 #endif 417 418 #ifndef P_SPORT1_RSCLK 419 #define P_SPORT1_RSCLK P_UNDEF 420 #endif 421 422 #ifndef P_PPI2_D0 423 #define P_PPI2_D0 P_UNDEF 424 #endif 425 426 #ifndef P_PPI2_D1 427 #define P_PPI2_D1 P_UNDEF 428 #endif 429 430 #ifndef P_PPI2_D2 431 #define P_PPI2_D2 P_UNDEF 432 #endif 433 434 #ifndef P_PPI2_D3 435 #define P_PPI2_D3 P_UNDEF 436 #endif 437 438 #ifndef P_PPI2_D4 439 #define P_PPI2_D4 P_UNDEF 440 #endif 441 442 #ifndef P_PPI2_D5 443 #define P_PPI2_D5 P_UNDEF 444 #endif 445 446 #ifndef P_PPI2_D6 447 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