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/drivers/pci/controller/
Dpcie-xilinx-cpm.c125 static u32 pcie_read(struct xilinx_cpm_pcie_port *port, u32 reg) in pcie_read() function
138 return (pcie_read(port, XILINX_CPM_PCIE_REG_PSCR) & in cpm_pcie_link_up()
144 unsigned long val = pcie_read(port, XILINX_CPM_PCIE_REG_RPEFR); in cpm_pcie_clear_err_interrupts()
163 val = pcie_read(port, XILINX_CPM_PCIE_REG_IDRN_MASK); in xilinx_cpm_mask_leg_irq()
177 val = pcie_read(port, XILINX_CPM_PCIE_REG_IDRN_MASK); in xilinx_cpm_unmask_leg_irq()
222 pcie_read(port, XILINX_CPM_PCIE_REG_IDRN)); in xilinx_cpm_pcie_intx_flow()
236 val = pcie_read(port, XILINX_CPM_PCIE_REG_IMR); in xilinx_cpm_mask_event_irq()
248 val = pcie_read(port, XILINX_CPM_PCIE_REG_IMR); in xilinx_cpm_unmask_event_irq()
282 val = pcie_read(port, XILINX_CPM_PCIE_REG_IDR); in xilinx_cpm_pcie_event_flow()
283 val &= pcie_read(port, XILINX_CPM_PCIE_REG_IMR); in xilinx_cpm_pcie_event_flow()
[all …]
Dpcie-xilinx.c116 static inline u32 pcie_read(struct xilinx_pcie_port *port, u32 reg) in pcie_read() function
128 return (pcie_read(port, XILINX_PCIE_REG_PSCR) & in xilinx_pcie_link_up()
139 unsigned long val = pcie_read(port, XILINX_PCIE_REG_RPEFR); in xilinx_pcie_clear_err_interrupts()
357 val = pcie_read(port, XILINX_PCIE_REG_IDR); in xilinx_pcie_intr_handler()
358 mask = pcie_read(port, XILINX_PCIE_REG_IMR); in xilinx_pcie_intr_handler()
397 val = pcie_read(port, XILINX_PCIE_REG_RPIFR1); in xilinx_pcie_intr_handler()
407 val = pcie_read(port, XILINX_PCIE_REG_RPIFR2) & in xilinx_pcie_intr_handler()
519 pcie_write(port, pcie_read(port, XILINX_PCIE_REG_IDR) & in xilinx_pcie_init_port()
527 pcie_write(port, pcie_read(port, XILINX_PCIE_REG_RPSC) | in xilinx_pcie_init_port()
/drivers/staging/mt7621-pci/
Dpci-mt7621.c145 static inline u32 pcie_read(struct mt7621_pcie *pcie, u32 reg) in pcie_read() function
205 return pcie_read(pcie, RALINK_PCI_CONFIG_DATA); in read_config()
557 val = pcie_read(pcie, RALINK_PCI_PCIMSK_ADDR); in mt7621_pcie_enable_port()