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29 #define INTGR0_INTGC(__n) (1 << ((__n) + 16)) argument31 #define INTGR0_INTGD(__n) (1 << (__n)) argument36 #define INTCR0_INTGC(__n) (1 << ((__n) + 16)) argument38 #define INTCR0_INTCD(__n) (1 << ((__n) + 16)) argument43 #define INTMR0_INTMC(__n) (1 << ((__n) + 16)) argument45 #define INTMR0_INTMD(__n) (1 << (__n)) argument50 #define INTSR0_GET_INTSD(x, __n) (((x) >> (__n)) & 0x1) argument52 #define INTSR0_GET_INTSC(x, __n) (((x) >> ((__n) + 16)) & 0x1) argument57 #define INTMSR0_GET_INTMSD(x, __n) (((x) >> (__n)) & 0x1) argument59 #define INTMSR0_GET_INTMSC(x, __n) (((x) >> ((__n) + 16)) & 0x1) argument[all …]
24 #define SOLO_SYS_CFG_OUTDIV(__n) (((__n) & 0x003) << 3) argument25 #define SOLO_SYS_CFG_FEEDBACKDIV(__n) (((__n) & 0x1ff) << 5) argument26 #define SOLO_SYS_CFG_INPUTDIV(__n) (((__n) & 0x01f) << 14) argument28 #define SOLO_SYS_CFG_NCLK_DELAY(__n) (((__n) & 0x003) << 24) argument29 #define SOLO_SYS_CFG_PCLK_DELAY(__n) (((__n) & 0x00f) << 26) argument182 #define SOLO_VI_STATUS0_PAGE(__n) ((__n) & 0x07) argument
49 #define CSIO_VALID_WWN(__n) ((*__n >> 4) == 0x5 ? true : false) argument
348 #define CT2_CSI_MAC_CONTROL_REG(__n) \ argument350 (__n) * (CT2_CSI_MAC1_CONTROL_REG - CT2_CSI_MAC0_CONTROL_REG))
347 #define CT2_CSI_MAC_CONTROL_REG(__n) \ argument349 (__n) * (CT2_CSI_MAC1_CONTROL_REG - CT2_CSI_MAC0_CONTROL_REG))
160 #define REG_MTX(__n) (0x4f + (__n) - 1) argument163 #define REG_LCC(__n) (0x62 + (__n) - 1) argument
127 #define REG_BIT(__n) \ argument128 ((u32)(BIT(__n) + \129 BUILD_BUG_ON_ZERO(__is_constexpr(__n) && \130 ((__n) < 0 || (__n) > 31))))